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17.c.13.nom数据表与规格注明

17.c.13.nom数据表与规格注明

AT17C020是Atmel的非易失性配置存储器,重要用于保留FPGA启动时读取的配置数据 ;断电后,存储内容仍可保留。硬件工程师选型时可先确认容量和串行配置用处,再查对具体器件版本的电气个性与封装引脚。

AT17C020数据表重点

这类器件的主题用处不是通用文件存储,而是为可编程逻辑器件提供配置数据。系统上电后,FPGA节造配置过程,通过串行信号从存储器中读出数据,并据此成立逻辑职能。理解数据表时,容量、存储类型和信号职能是最先必要关注的项目。

字段 规格或注明
器件型号 AT17C020
存储类型 非易失性EEPROM
存储容量 2 Mbit,即2,097,152 bit
容量换算 262,144 byte,约256 KiB
数据组织示意 256K × 8 bit(按容量换算暗示)
数据传输方式 串行数据传输
典型用处 保留并提供FPGA配置数据

2 Mbit暗示器件可存放的总位数,换算为字节约为256 KiB。它描述的是存储空间,不代表FPGA最终可用逻辑单元数量,也不等同于处置器的运行内存。现实配置文件能否装入器件,还取决于指标FPGA所需的数据量。

工程查对参数示例

下表把容量类规格与调试时可选取的示例值分隔列出。3.3 V和1 MHz是用于注明设计查对步骤的工程示例,不应视为AT17C020所有版本的保障规格 ;选型和量产前,须按现实器件版本的数据表核实供电领域、时钟限度及其测试前提。

参数字段 具体值或规格标识 使用注明
存储容量 2 Mbit 器件容量标识 ;对应2,097,152 bit
容量组织示意 256K × 8 bit 用于理解字节换算,不代替厂家对内部组织的界说
板级供电示例 3.3 V 仅为示例设计电压,现实衔接前查对器件电气规格
初始调试时钟示例 1 MHz 可作为低速联调的起点 ;不得据此揣度最高时钟频率
串行数据宽度 1 bit/时钟 用于描述串行传输方式,时序边缘和限度以具体数据表为准

硬件设计者可吓酌上述容量值判断配置文件是否有机遇装入器件 ;随后应从现实数据表确认电源前提、输入阈值、时钟时序和封装脚位。调试人员若以1 MHz作为初始时钟,应在确认器件和FPGA均能接受该设置后再逐措施整,不要把示例值直接当作器件极限参数。

重要信号及作用

  • DATA:串行数据通路,配置数据由此送往FPGA。
  • CLK:时钟输入,为串行数据读取和传送提供节拍。
  • CE:片选节造信号,用于节造器件是否参加当前读取过程。
  • RESET/OE:复位或输出使能有关节造信号,共同配置启动过程治理器件状态。
  • CEO:级联有关信号,可用于多器件配置链路中的衔接。
  • VCC、GND:别离衔接电源与地,为芯片提供工作前提。

具体封装中的引脚编号和引脚分列,应以AT17C020对应封装图为准。阅读时要把信号名称与封装编号分隔:DATA、CLK等暗示电气职能,封装图才指出它们现实位于芯片的哪个脚位 ;嬖斓览硗际,工程师应逐项对照封装图,并查抄电源脚、地脚和节造脚,预防把职能名误当成脚号。

上电配置过程

  1. 系统供电后,复位与使能节造信号进入相应状态,配置存储器和FPGA起头筹备工作。
  2. FPGA或配置节造逻辑提供时钟,AT17C020按串行方式输出已保留的数据。
  3. FPGA接管配置流并成立内部逻辑 ;数据读取过程由时钟和节造信号共同共同。
  4. 配置实现后,FPGA进入用户逻辑运行状态,存储器则实现本次启动配置工作。

这套流程的关键是启动节造、时钟和数据蹊径之间的共同。若开发板上电后没有进入预期职能,调试人员可先丈量供电,再查抄复位状态、片选节造、时钟是否达到以及DATA线路是否连通,最后查对FPGA配置文件与指标器件是否匹配。

数据表阅读与利用沉点

AT17C020数据表适合硬件设计、器件代替评估和故障定位时查阅。硬件设计者通常先确认容量能覆盖FPGA配置数据,再凭据引脚职能绘造衔接关系 ;调试人员则关注启动时序和串行数据蹊径。若设计蕴含级联配置器件,还需结合整个配置链路查抄CEO等有关信号的衔接。

与通常可移动存储器分歧,AT17C020面向FPGA启动配置场景,沉点在于靠得住地保留并按序输出配置流,而不是提供用户文件读写界面。它也分歧于FPGA内部的运行逻辑:配置存储器保留启动所需的数据,FPGA读取这些数据后才形成预约职能。

因而,查阅17.c.13.nom有关资料时,可将AT17C020的容量、EEPROM属性、串行传输和配置用处作为阅读主线。查看数据表时,把电气衔接、节造信号、封装脚位和配置流程对应起来 ;设计者据此实现选型与连线,调试人员则可按供电、节造、时钟、数据的挨次定位启动问题。

[责任编纂:蔡英文]

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